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参数资料
型号： 1215E
英文描述： TEST/JTAG SUPPORT|CMOS|QFP|48PIN|PLASTIC
中文描述： 测试/ JTAG支持|的CMOS | QFP封装| 48PIN |塑料
文件页数： 90/92页
文件大小： 1041K
代理商： 1215E
90
Agere Systems Inc.
User Manual
April 2001
Advanced Operational Mode
497AE and 1215E Boundary-Scan Master 2
MEMRETE 23, 50
MEMSIG 50, 51
MEMSKIP 23, 50
monitoring user selected signal 8, 78
N
NC 15, 19, 20
NCR 15, 19, 20, 61
normal scan operation 8, 56
notation 5
O
OR tree 41, 44
OUIM 9, 41
output control data 16
overflow condition 9, 12, 41
P
power 7
power dissipation 21
powerup 35
processor 35
processor interface
1215E address bus 7
497AE address bus 7
data bus 7
read and write operations 7
programmable logic, application for 11
programmed actions
timing of 36
PRPG 15, 21, 29, 62
PSBIST 22
pseudocode 24
pseudorandom pattern generator
seed value 29, 62
pseudorandom test patterns 62
PTR 7, 35, 37
PWR/VDD 68, 79
Q
quick reference
BIR 64
R
R/W* 7, 67, 79
RA 36, 67
random logic
core portions of BSM2 22
noncore of BSM2 22
RDY 7, 67, 78
read/write synchronization 36
register
23 (octal), undefined 35
ATPG pseudorandom pattern generation 62
ATPG signature analysis 63
BIST signature 51, 58
BIST, control- 50
control-scan/clock 15, 38, 39, 40
default value 35
IDLE counter 11, 15, 24, 38, 47, 57
loop counter 15, 59
MASK/USEROUT0(1), control- 35, 49
net count 15, 61
pointer 37
scan duration 15, 60
scan duration counter 15
signature analysis 17
status (see also “STAT”) 8, 38, 41, 46, 78
TCK divider 39
TVI address pointer 52
TVI memory 54
TVO address pointer 53
TVO memory 55
TVX counter 11, 24, 47, 56
USEROUT0/TAP function/output enable, control- 44,
45
USEROUT1/test data/interrupt, control- 41, 42, 43
register size 36
registers
altering BSM2 configuration 35
associated with programming of scanning tasks 35
classification of 35
internal 21
response data 16
retention testing, memory 23, 50
retimed delay 86
retimed delay control 39
RL_DONE 50, 51, 58
RLSIG 58
RLSKIP 23, 50, 58
RLSKP 22
RST* 67, 78
RTD 39
S
SAR 8, 11, 13, 14, 15, 16, 17, 18, 21, 24, 29, 63, 86
scan downloads 11
scan duration counter 15
scan operation 11
“single step” 42
defined starting state 11
execution 42
recirculate mode 14, 42
recirculate mode with response only 14, 42
SCT 15, 39, 40
SDC 15, 19, 47
SDR 15, 19, 60
sequential test vector 20
sharing TAP bus 45
signature
memory BIST 50, 51
random logic BIST 50, 58
signature analysis 17, 63
polynomial, hard-wired 63
seed value 29, 63
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